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《HDL图形设计工具》(HDL Desing Entry EASE )v7.4.R8 [压缩包]

  • 状态: 精华资源
  • 摘要:
    发行时间2012年
    制作发行HDL Works
    语言英文
  • 时间: 2012/06/24 13:46:10 发布 | 2012/06/24 17:12:08 更新
  • 分类: 软件  行业软件 

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精华资源: 3862

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中文名HDL图形设计工具
英文名HDL Desing Entry EASE
资源格式压缩包
版本v7.4.R8
发行时间2012年
制作发行HDL Works
语言英文
简介

IPB Image


软件类型:软件>行业软件
软件性质:破解软件
操作系统:Windows
应用平台:Winall
问题反馈:http://www.hdlworks.com/support/index.html
网站链接:http://www.hdlworks.com/products/ease/index.html
软件简介 :


HDL Works公司的HDL Design Entry EASE 是一个HDL图形设计工具,整合了结构图、状态图、真值表、HDL 代码,是一个面对EASE环境的HDL图形设计工具.

EASE提供对VHDL、Verilog、FPGA和ASIC的混合语言等电路设计输入最佳环境,当完成设计后,允许使用者自行选择自己喜欢,由EASE提供独立的合成与模拟工具。
在市场上,EASE提供最直觉的设计输入环境,而且不管是对初学者或进阶者,提供HDL设计所需的特性,可选择文字方式或图形方式进行设计,EASE会自动依你选择的编程语言将图形转换成对应的HDL语言。


IPB Image

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http://www.hdlworks.com/products/ease/ease_viewlet_swf.html



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EASE offers the best of both worlds with your choice of graphical or text based HDL entry. You don’t need to be a master of either Verilog or VHDL. When you're creating a new design, just enter your design using your mix of graphics and text. EASE automatically generates optimized HDL code for you in the selected language - VHDL or Verilog. Industry standard version control environments deal with design and configuration management enabling multiple users to work simultaneously on one EASE project.



Features & Benefits
Graphical design environment with automated generation of hierarchical VHDL or Verilog code
Push-button import of legacy Verilog or VHDL designs and extraction of graphical hierarchy
Adheres to state of the art Windows look and feel for intuitive operation
Standards compliant (IEEE-1076-87&93 VHDL and IEEE-1364 Verilog)
True multi-user design environment and associated version control, managed by a sophisticated design environment browser
Integrates smoothly with the industry's most popular simulators and synthesis tools
Platform independent database
Integrated HDL language editor
Hot error reporting


代码
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±   Disks: 8 x 5,00mb                             Date : June 23, 2012        ±
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²  Release Description:
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   EASE offers the best of both worlds with your choice of graphical or
   text based HDL entry. You don’t need to be a master of either Verilog
   or VHDL. When you're creating a new design, just enter your design using
   your mix of graphics and text. EASE automatically generates optimized
   HDL code for you in the selected language - VHDL or Verilog. Industry
   standard version control environments deal with design and configuration
   management enabling multiple users to work simultaneously on one EASE
   project.

   Features & Benefits
   - Graphical design environment with automated generation of hierarchical
     VHDL or Verilog code
   - Push-button import of legacy Verilog or VHDL designs and extraction of
     graphical hierarchy
   - Adheres to state of the art Windows look and feel for intuitive operation
   - Standards compliant (IEEE-1076-87&93 VHDL and IEEE-1364 Verilog)
   - True multi-user design environment and associated version control,
     managed by a sophisticated design environment browser
   - Integrates smoothly with the industry's most popular simulators and
     synthesis tools
   - Platform independent database
   - Integrated HDL language editor
   - Hot error reporting

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    小贴士:
  1. 类似“顶”、“沙发”之类没有营养的文字,对勤劳贡献的楼主来说是令人沮丧的反馈信息。
  2. 提问之前请再仔细看一遍楼主的说明,或许是您遗漏了。
  3. 勿催片。请相信驴友们对分享是富有激情的,如果确有更新版本,您一定能搜索到。
  4. 请勿到处挖坑绊人、招贴广告。既占空间让人厌烦,又没人会搭理,于人于己都无利。
  5. 如果您发现自己的评论不见了,请参考以上4条。