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《电子设计套件》(Xilinx.ISE.Design.Suite)v13.4.LINUX[光盘镜像]

  • 状态: 精华资源
  • 摘要:
    发行时间2012年
    语言英文
  • 时间: 2012/02/09 21:32:07 发布 | 2012/02/09 22:06:42 更新
  • 分类: 软件  行业软件 

MTina

精华资源: 3862

全部资源: 3863

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中文名电子设计套件
英文名Xilinx.ISE.Design.Suite
资源格式光盘镜像
版本v13.4.LINUX
发行时间2012年
语言英文
简介

IPB Image

语言:英文
网址:http://www.xilinx.com/products/design-tools/ise-design-suite/index.htm
类别:电子设计套件



(from:china.xilinx)
Xilinx ISE Design Suite 设计套件是面向 Virtex -6 和 Spartan -6 FPGA 系列并针对生产力精心优化的工具套件,在降低功耗与成本方面取得了突破性进展。作为业界唯一一款特定领域的设计套件,赛灵思最新版本的发布, 是这一行业屡获殊荣的软件不断发展和演进的又一重要一步,它将进一步提高设计生产力和系统性能,使逻辑、嵌入式、数字信号处理 (DSP) 和系统设计人员能够更轻松地推出更复杂的创新型可编程电子产品,从而加速产品上市进程并提升产品质量。

ISE DESIGN SUITE 的主要优势

针对 VIRTEX -6 和 SPARTAN -6 FPGA:
● 利用自动时钟门控技术将动态功耗降低30%之多
● 利用第四代部分重配置设计流程降低系统成本
● PlanAhead - 面向逻辑设计人员的新款 RTL 到比特流设计流程
● 利用 AXI4 接口实现即插即用式 FPGA 设计



全球可编程平台领导厂商赛灵思公司 (Xilinx, Inc. (NASDAQ:XLNX) )宣布推出 ISE Design Suite 13.4设计套件。该设计套件可提供对 MicroBlaze 微控制器系统 (MCS) 的公共访问功能、面向 28nm 7 系列 FPGA 的全新 RX 裕量分析和调试功能,以及支持面向 Artix -7 系列和 Virtex -7 XT 器件的部分可重配置功能。

MicroBlaze MCS 可显著简化微控制器设计
MicroBlaze MCS 是赛灵思 LogiCORE IP核解决方案的新成员,可为赛灵思客户提供交钥匙微控制器解决方案。它包含 MicroBlaze 处理器、用于程序和数据存储的本地存储器,以及紧密耦合的 GPIO、时钟、中断控制器和其它标准外设。

MCS 得到了众多赛灵思 FPGA 系列器件的广泛支持,经预配置可帮助硬件开发人员简化部署工作。不仅软件开发人员会发现一些熟悉的工具,诸如赛灵思软件开发套件 (SDK)、命令行 gcc、赛灵思微处理器调试器 (XMD) 和与较大型处理器配置使用相同标准的MicroBlaze API,而且硬件开发人员也将欣慰地发现,除了得到Cadence、Mentor和赛灵思仿真解决方案的支持外,MicroBlaze 处理器和所有的赛灵思嵌入式 IP 核现在还得到了 Synopsys VCS 仿真器的支持。MicroBlaze MCS 现包含在ISE 设计套件的所有版本和 ISE WebPACK 中,并与 AutoESL 高级综合工具 v2011.4 版兼容。

全新 RX 裕量分析工具
ISE Design Suite 13.4 版中提供的 ChipScope Pro 工具现提供一款 RX 裕量分析工具,可帮助工程师优化信号质量,降低设计误码率 (BER)。RX 裕量分析工具采用二维眼图扫描统计算法,可以通过交互方式实时地或者在运行后处理过程中表征和优化信道质量。

第四代部分可重配置功能
PlanAhead 工具现可提供支持面向 Artix-7 和 Virtex-7 FPGA 的部分可重配置功能。部分可重配置功能可以动态地重配置逻辑模块,同时不影响其他逻辑的运行。这就意味着设计人员可使用 Artix-7 和 Virtex-7 XT 器件构建高度灵活的系统,能够在运行过程中更换功能或者进行远程更新。此外,部分可重配置功能还可让设计人员通过充分利用时间复用的优势,即采用尺寸更小、数量更少的器件,减少板级空间和最大限度地降低比特流的存储要求,最终降低成本和设计尺寸。采用更小和更少的器件还可降低系统功耗,而更换出高耗能任务则能够最大限度地降低 FPGA 的动态功耗。这标志着赛灵思首次可面向从低成本到高端的所有7系列 FPGA产品提供部分可重配置功能。

扩展对 7 系列 FPGA 的支持
ISE Design Suite 13.4 设计套件是首个支持 Artix-7 和 Virtex-7 XT FPGA 系列的公开版本。

Artix-7 FPGA 具有业界最低的功耗和成本,可广泛应用于消费类 3D 电视、多功能打印机、数码单反相机、汽车驾驶员辅助和信息娱乐、低功耗手持通信、医疗内窥镜、手持超声设备以及工业系统监控和控制等大批量市场的需求。所有的 28nm 赛灵思器件均具有灵活混合信号 (AMS) 功能,故设计人员可运用此业界最为灵活的通用模拟接口定制各种应用,从简单的控制与排序到诸如线性化、校正和滤波等信号处理强度更大的任务。

Virtex-7 XT 器件采用高性能收发器、数字信号处理器 (DSP) 和 BRAM 可提供最高处理带宽。Virtex-7 XT 器件前所未有地集成了多达 96 个 10G Base KR 背板功能串行收发器,DSP性能高达 5.3 TMAC ,并内置有67Mb 的内部存储器和超过 100 万个逻辑单元。Virtex-7 XT 系列采用赛灵思具有革命性创新的堆迭硅片互联技术 (SSI) 将多个晶片集成到单个芯片中,与多芯片解决方案相比,单芯片解决方案的芯片间单位功耗带宽可提高100倍。

PlanAhead 工具可显著提高用户生产率
赛灵思ISE PlanAhead 设计和分析工具是一种可用于设计创建、分析、布局和实现的综合性开发环境。PlanAhead 工具采用独特的 front-to-back 环境,能够为设计周期的每一个阶段 —— RTL 开发、IP 集成、验证、综合、布局布线 —— 提供设计分析功能,从而加速量产进程。采用该工具,可减少费时费力的设计迭代,快速权衡功耗、资源利用和性能要求。前端的设计分析和设计保护流程可确保流程间的时间恰到好处,对用户充分发挥新型 7 系列器件的功能具有至关重要的意义。

PlanAhead 工具目前可针对赛灵思 7 系列 FPGA 提供公共访问功能,不仅能够提升工作效率,帮助用户快速完成设计,而且其具备的智能时钟门控技术还能大幅降低功耗。此外,其现在为Artix-7 FPGA 和 Virtex-7 XT FPGA 提供的团队设计流程与第五代部分可重配置技术也可精减所使用器件的数量和尺寸,进而降低功耗、改进系统的升级能力。

IPB Image

代码
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      ▀▄       ██                     Xilinx                   ██     ■▀
        ▀■  ▄▄██▀             ISE Design Suite v13.4           ▀██▄▄
        ▄▄██▀▀░                                                  ░▀▀██▄▄
      ▄▓██▀░░      SUPPLiER....: TEAM TBE    DATE ...: 02.02.2012  ░░▀██▓▄
     ▐▓██▌░        CRACKER ....: TEAM TBE    TYPE ...: util           ░▐██▓▌
      ▀▓██▄░░      PROTECTiON .: Flex LM     OS .....: linux       ░░▄██▓▀
       ░▀▓██▄░░    LANGUAGE   .: english     SiZE ...: 1DVD      ░ ▄██▓▀░
         ▓ ▀▀██▄▄░░                                          ░░▄▄██▀▀ ▓
         ░ ▀▄▄ ▀▀██▄▄    url:http://www.xilinx.com         ▄▄██▀▀ ▄▄▀ ░
         ░ ▄▄██▀ ░▓████▄▄▄     *  RELEASE NOTES  *    ▄▄▄████▓░ ▀██▄▄ ░
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       ▓██▄  ░█      The  ISE  Design Suite: System Edition      █  ░▄███
       ░▀▀██▄▄  ▄    provides   a   comprehensive  suite of    ▄  ▄▄▓█▀▀
       ░    ▀▀▀▀     integrated    development environment,     ▀▀▀▀█
              ▓      software tools, configuration wizards,      ▓  ▓
              ▓      and  IP  that  facilitates your design      █
              █      and  utilizes  all  of the flexibility      █  ░                  
              █      offered  by  a  programmable platform.      █
              █      Xilinx     CORE     Generator™ System,      █
              █      included  in  all  Editions of the ISE      █
              █      Design  Suite, accelerates design time      █
              █      by    providing    access    to highly      █
              █      parameterized  Intellectual Properties      █
              █      (IP)  for Xilinx FPGAs and is included      █
              █      in the ISE Design Suite. The available      █
              █      user-customizable  IP  functions range      █
              █      in   complexity   from   commonly used      █
              █      functions, such as memories and FIFOs,      █
              █      to  system-level building blocks, such      █
              █      as filters and transforms. Using these      █
              █      IP  blocks  can save days to months of      █
              █      design  time.  The highly optimized IP      █
              █      allows FPGA designers to focus efforts      █
              █      on   building   designs  quicker while      █
              █      helping   bring   products   to market      █
              █      faster.                                     █
              █                                                  █
              ▀                                                  ▀
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      ▀▓██▄░  ▓     2) burn / mount                               ▓   ▄██▓▀
        ▀▀██▄▄░     3) install                                    ▄▄██▀▀
           ▄▀▀██▄   4) crack dir                               ▄██▀▀▄
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           ▓  █   ░ We got several positions to fill, if at      █
           ▓  █ ▄   least one of the following characteristics   █
           ░  █▀▓▀  fits to you:                                 █
              █                                                  █
              █     1. You work at any reseller, distributor     █
              █        or software company and have access       █
              █        to new unreleased software                █
              █                                                  █
              █     2. You are a talented cracker and able to    █
              █        handle one or more of the following       █
              █        protections:                              █
              █        Dongle, FlexLM, Armadillo, SafeDisc,      █
              █        Asprotect, SecuROM                        █
              █                                                  █
              █     3. You are able to code usefull tools in     █
              █        C/C++ or ASM                              █
              █                                                  █
              █     4. You are a keygenner and able to handle    █
              █        MD5, RSA, TEA, Blowfish, SHA1, RipeMD,    █
              █        DES, Triple DES or Rijndael Twofish       █
              █                                                  █
              █     5. You think you got something we might      █
              █        need                                      █
              █                                                  █
              ▓                                                  ▓
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           █░  ░▓███          iMMERSiON - ZWTiSO            ███▓░  ░█
            ▀ ▄▓██▀░                                        ░▀██▓▄ ▀
        ▄  ▄▄███▀  ░        ISO - TMG - ACME - SSG          ░ █▀███▄▄  ▄
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   ███  ████▓░                   JUGGA Family                 █   ░▓████  ███
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(?) [公告]留口水、评论相关规则 | [活动]每日签到 轻松领取电驴经验

    小贴士:
  1. 类似“顶”、“沙发”之类没有营养的文字,对勤劳贡献的楼主来说是令人沮丧的反馈信息。
  2. 提问之前请再仔细看一遍楼主的说明,或许是您遗漏了。
  3. 勿催片。请相信驴友们对分享是富有激情的,如果确有更新版本,您一定能搜索到。
  4. 请勿到处挖坑绊人、招贴广告。既占空间让人厌烦,又没人会搭理,于人于己都无利。
  5. 如果您发现自己的评论不见了,请参考以上4条。